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【亞博】Altera和ARM攜手推出DS-5開發套件,加速產品開發時間

    作者:亞博 時間:2019-05-14

  Altrea與安謀國際(ARM)聯袂沖破SoC FPGA除錯壁壘。Altera與ARM透過兩邊特有和談,配合推出DS-5嵌入式軟件開辟套件,期消弭工程師在開辟SoC FPGA時,所面對的軟硬件除錯問題,進一步加快開辟時程。

  Altera國際市場總監李儉指出,工程師平均花60~70%的開辟時候在除錯上,透過與ARM的合作,將可以實現跨軟硬體的除錯情況,加快工程師開辟產物的時候。

圖 Altera國際市場總監李儉

  Altera國際市場總監李儉暗示,FPGA的高矯捷性,可以或許讓客戶隨機增添產物功能,并提高產物差別化水平,但如許的特點讓工程師在開辟SoC FPGA時,必需面臨更多的挑戰。過往在開辟進程傍邊,常常由于軟件與硬件開辟工程師沒法協力除錯,軟、硬件必要別離利用兩套除錯東西,而延遲產物上市時候,是以,Altera與ARM合作推出DS-5嵌入式軟件開辟套件,逾越軟硬體間除錯障礙,協助客戶下降產物開辟時候。

Altera和ARM攜手推出DS-5開發套件,加速產品開發時間

  ARM亞太區利用工程總監姜新雨指出,透過與Altera的合作,ARM開辟東西團隊可以得知利用者簡直切需求,并開辟出響應產物以加快客戶的產物上市時候。此款專為Altera SoC FPGA設計的ARM DS-5東西套件,將有助在習用ARM架構處置器的工程師,可以或許在治理介面上一覽ARM Cortex-A9處置器焦點與Altera FPGA的除錯、追蹤資料。

  姜新雨進一步注釋,DS-5開辟套件具主動調劑功能,讓DS-5可以或許支援FPGA架構中訊息事務的非置入式收集和視覺化功能,并讓工程師不雅察出該事務與軟體事務和處置器指令蹤影,透過時候戳記,找出彼此在時候上的聯系關系性。另外一方面,DS-5的交叉觸發功能則讓CPU與FPGA區域之間的高階訊號層級硬體交叉觸發,讓工程師可以住手CPU或是FPGA任何一真個運作,并闡發毛病資訊,實現跨軟體和硬體的除錯。

  DS-5開辟套件在上市以后,將支援對運行非對稱多處置(AMP)和對稱多處置(SMP)系統組態的系統進行除錯,還可以透過JTAG和乙太網路除錯介面,普遍利用在電路板開辟、驅動程式開辟、OS移植、裸金屬和Linux利用開辟和除錯。

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